tegra: add GPIO controller driver
Taken from the Linux kernel, simplified and reworked to match barebox. Signed-off-by: Lucas Stach <dev@lynxeye.de> Tested-by: Antony Pavlov <antonynpavlov@gmail.com> Signed-off-by: Sascha Hauer <s.hauer@pengutronix.de>
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parent
f23adabf6c
commit
fbcb481c60
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@ -142,6 +142,8 @@ config ARCH_TEGRA
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select BUILTIN_DTB
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select BUILTIN_DTB
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select COMMON_CLK
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select COMMON_CLK
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select CLKDEV_LOOKUP
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select CLKDEV_LOOKUP
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select GPIOLIB
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select GPIO_TEGRA
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select OFDEVICE
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select OFDEVICE
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select OFTREE
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select OFTREE
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@ -18,6 +18,22 @@
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#clock-cells = <1>;
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#clock-cells = <1>;
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};
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};
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gpio: gpio {
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compatible = "nvidia,tegra20-gpio";
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reg = <0x6000d000 0x1000>;
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interrupts = <0 32 0x04
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0 33 0x04
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||||||
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0 34 0x04
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0 35 0x04
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||||||
|
0 55 0x04
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||||||
|
0 87 0x04
|
||||||
|
0 89 0x04>;
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||||||
|
#gpio-cells = <2>;
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||||||
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gpio-controller;
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||||||
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#interrupt-cells = <2>;
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|
interrupt-controller;
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||||||
|
};
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||||||
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pmc {
|
pmc {
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compatible = "nvidia,tegra20-pmc";
|
compatible = "nvidia,tegra20-pmc";
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reg = <0x7000e400 0x400>;
|
reg = <0x7000e400 0x400>;
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||||||
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@ -0,0 +1 @@
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#include <asm-generic/gpio.h>
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@ -36,6 +36,13 @@ config GPIO_PL061
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config GPIO_STMPE
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config GPIO_STMPE
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depends on MFD_STMPE
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depends on MFD_STMPE
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bool "STMPE GPIO Expander"
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bool "STMPE GPIO Expander"
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config GPIO_TEGRA
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bool "GPIO support for the Tegra SoCs"
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depends on ARCH_TEGRA
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help
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Say yes here to include the driver for the GPIO controller found on the
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Tegra line of SoCs.
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endmenu
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endmenu
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||||||
endif
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endif
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@ -4,3 +4,4 @@ obj-$(CONFIG_GPIO_CLPS711X) += gpio-clps711x.o
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obj-$(CONFIG_GPIO_GENERIC) += gpio-generic.o
|
obj-$(CONFIG_GPIO_GENERIC) += gpio-generic.o
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||||||
obj-$(CONFIG_GPIO_PL061) += gpio-pl061.o
|
obj-$(CONFIG_GPIO_PL061) += gpio-pl061.o
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||||||
obj-$(CONFIG_GPIO_STMPE) += gpio-stmpe.o
|
obj-$(CONFIG_GPIO_STMPE) += gpio-stmpe.o
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||||||
|
obj-$(CONFIG_GPIO_TEGRA) += gpio-tegra.o
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||||||
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@ -0,0 +1,214 @@
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/* *
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|
* Copyright (C) 2010 Erik Gilling <konkers@google.com>, Google, Inc
|
||||||
|
* Copyright (C) 2013 Lucas Stach <l.stach@pengutronix.de>
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||||||
|
*
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|
* This program is free software; you can redistribute it and/or modify it
|
||||||
|
* under the terms and conditions of the GNU General Public License,
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||||||
|
* version 2, as published by the Free Software Foundation.
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|
*
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||||||
|
* This program is distributed in the hope it will be useful, but WITHOUT
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||||||
|
* ANY WARRANTY; without even the implied warranty of MERCHANTABILITY or
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||||||
|
* FITNESS FOR A PARTICULAR PURPOSE. See the GNU General Public License for
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|
* more details.
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*
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|
* You should have received a copy of the GNU General Public License
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|
* along with this program. If not, see <http://www.gnu.org/licenses/>.
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*/
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#include <common.h>
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#include <gpio.h>
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#include <init.h>
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#include <io.h>
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#include <linux/err.h>
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#define GPIO_BANK(x) ((x) >> 5)
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#define GPIO_PORT(x) (((x) >> 3) & 0x3)
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#define GPIO_BIT(x) ((x) & 0x7)
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#define GPIO_REG(x) (GPIO_BANK(x) * config->bank_stride + \
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GPIO_PORT(x) * 4)
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#define GPIO_CNF(x) (GPIO_REG(x) + 0x00)
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#define GPIO_OE(x) (GPIO_REG(x) + 0x10)
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#define GPIO_OUT(x) (GPIO_REG(x) + 0x20)
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#define GPIO_IN(x) (GPIO_REG(x) + 0x30)
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#define GPIO_INT_ENB(x) (GPIO_REG(x) + 0x50)
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#define GPIO_MSK_CNF(x) (GPIO_REG(x) + config->upper_offset + 0x00)
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#define GPIO_MSK_OE(x) (GPIO_REG(x) + config->upper_offset + 0x10)
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#define GPIO_MSK_OUT(x) (GPIO_REG(x) + config->upper_offset + 0X20)
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struct tegra_gpio_bank {
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int bank;
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int irq;
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};
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struct tegra_gpio_soc_config {
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u32 bank_stride;
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u32 upper_offset;
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u32 bank_count;
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};
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static void __iomem *gpio_base;
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static struct tegra_gpio_soc_config *config;
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static inline void tegra_gpio_writel(u32 val, u32 reg)
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{
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writel(val, gpio_base + reg);
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}
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static inline u32 tegra_gpio_readl(u32 reg)
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{
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return readl(gpio_base + reg);
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}
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static int tegra_gpio_compose(int bank, int port, int bit)
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{
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return (bank << 5) | ((port & 0x3) << 3) | (bit & 0x7);
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}
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static void tegra_gpio_mask_write(u32 reg, int gpio, int value)
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{
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u32 val;
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val = 0x100 << GPIO_BIT(gpio);
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if (value)
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val |= 1 << GPIO_BIT(gpio);
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|
tegra_gpio_writel(val, reg);
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|
}
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static void tegra_gpio_enable(int gpio)
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{
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|
tegra_gpio_mask_write(GPIO_MSK_CNF(gpio), gpio, 1);
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|
}
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static void tegra_gpio_disable(int gpio)
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|
{
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tegra_gpio_mask_write(GPIO_MSK_CNF(gpio), gpio, 0);
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|
}
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|
static int tegra_gpio_request(struct gpio_chip *chip, unsigned offset)
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|
{
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|
return 0;
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|
}
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static void tegra_gpio_free(struct gpio_chip *chip, unsigned offset)
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|
{
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||||||
|
tegra_gpio_disable(offset);
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|
}
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static void tegra_gpio_set(struct gpio_chip *chip, unsigned offset, int value)
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|
{
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|
tegra_gpio_mask_write(GPIO_MSK_OUT(offset), offset, value);
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||||||
|
}
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|
static int tegra_gpio_get(struct gpio_chip *chip, unsigned offset)
|
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|
{
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||||||
|
/* If gpio is in output mode then read from the out value */
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||||||
|
if ((tegra_gpio_readl(GPIO_OE(offset)) >> GPIO_BIT(offset)) & 1) {
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||||||
|
printf("GPIO output mode\n");
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||||||
|
return (tegra_gpio_readl(GPIO_OUT(offset)) >>
|
||||||
|
GPIO_BIT(offset)) & 0x1;
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||||||
|
}
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||||||
|
|
||||||
|
printf("GPIO input mode\n");
|
||||||
|
return (tegra_gpio_readl(GPIO_IN(offset)) >> GPIO_BIT(offset)) & 0x1;
|
||||||
|
}
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|
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||||||
|
static int tegra_gpio_direction_input(struct gpio_chip *chip, unsigned offset)
|
||||||
|
{
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||||||
|
tegra_gpio_mask_write(GPIO_MSK_OE(offset), offset, 0);
|
||||||
|
tegra_gpio_enable(offset);
|
||||||
|
return 0;
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||||||
|
}
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||||||
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|
static int tegra_gpio_direction_output(struct gpio_chip *chip, unsigned offset,
|
||||||
|
int value)
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||||||
|
{
|
||||||
|
tegra_gpio_set(chip, offset, value);
|
||||||
|
tegra_gpio_mask_write(GPIO_MSK_OE(offset), offset, 1);
|
||||||
|
tegra_gpio_enable(offset);
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
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|
static struct gpio_ops tegra_gpio_ops = {
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||||||
|
.request = tegra_gpio_request,
|
||||||
|
.free = tegra_gpio_free,
|
||||||
|
.direction_input = tegra_gpio_direction_input,
|
||||||
|
.direction_output = tegra_gpio_direction_output,
|
||||||
|
.get = tegra_gpio_get,
|
||||||
|
.set = tegra_gpio_set,
|
||||||
|
};
|
||||||
|
|
||||||
|
static struct gpio_chip tegra_gpio_chip = {
|
||||||
|
.ops = &tegra_gpio_ops,
|
||||||
|
.base = 0,
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||||||
|
};
|
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|
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||||||
|
static int tegra_gpio_probe(struct device_d *dev)
|
||||||
|
{
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||||||
|
int i, j, ret;
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||||||
|
|
||||||
|
ret = dev_get_drvdata(dev, (unsigned long *)&config);
|
||||||
|
if (ret) {
|
||||||
|
dev_err(dev, "dev_get_drvdata failed: %d\n", ret);
|
||||||
|
return ret;
|
||||||
|
}
|
||||||
|
|
||||||
|
gpio_base = dev_request_mem_region(dev, 0);
|
||||||
|
if (!gpio_base) {
|
||||||
|
dev_err(dev, "could not get memory region\n");
|
||||||
|
return -ENODEV;
|
||||||
|
}
|
||||||
|
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|
for (i = 0; i < config->bank_count; i++) {
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||||||
|
for (j = 0; j < 4; j++) {
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||||||
|
int gpio = tegra_gpio_compose(i, j, 0);
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||||||
|
tegra_gpio_writel(0x00, GPIO_INT_ENB(gpio));
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||||||
|
}
|
||||||
|
}
|
||||||
|
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||||||
|
tegra_gpio_chip.ngpio = config->bank_count * 32;
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|
tegra_gpio_chip.dev = dev;
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||||||
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||||||
|
gpiochip_add(&tegra_gpio_chip);
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||||||
|
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||||||
|
return 0;
|
||||||
|
}
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|
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|
static struct tegra_gpio_soc_config tegra20_gpio_config = {
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||||||
|
.bank_stride = 0x80,
|
||||||
|
.upper_offset = 0x800,
|
||||||
|
.bank_count = 7,
|
||||||
|
};
|
||||||
|
|
||||||
|
static struct platform_device_id tegra_gpio_ids[] = {
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||||||
|
{
|
||||||
|
.name = "tegra20-gpio",
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||||||
|
.driver_data = (unsigned long)&tegra20_gpio_config,
|
||||||
|
}, {
|
||||||
|
/* sentinel */
|
||||||
|
},
|
||||||
|
};
|
||||||
|
|
||||||
|
static __maybe_unused struct of_device_id tegra_gpio_dt_ids[] = {
|
||||||
|
{
|
||||||
|
.compatible = "nvidia,tegra20-gpio",
|
||||||
|
.data = (unsigned long)&tegra20_gpio_config
|
||||||
|
}, {
|
||||||
|
/* sentinel */
|
||||||
|
},
|
||||||
|
};
|
||||||
|
|
||||||
|
static struct driver_d tegra_gpio_driver = {
|
||||||
|
.name = "tegra-gpio",
|
||||||
|
.id_table = tegra_gpio_ids,
|
||||||
|
.of_compatible = DRV_OF_COMPAT(tegra_gpio_dt_ids),
|
||||||
|
.probe = tegra_gpio_probe,
|
||||||
|
};
|
||||||
|
|
||||||
|
static int __init tegra_gpio_init(void)
|
||||||
|
{
|
||||||
|
return platform_driver_register(&tegra_gpio_driver);
|
||||||
|
}
|
||||||
|
coredevice_initcall(tegra_gpio_init);
|
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