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* Copyright (C) 2011-2012 Jean-Christophe PLAGNIOL-VILLARD <plagnioj@jcrosoft.com>
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* Under GPLv2 only
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#ifndef __AT91_GPIO_H__
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#define __AT91_GPIO_H__
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#ifndef __gpio_init
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#define __gpio_init
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#endif
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#define MAX_NB_GPIO_PER_BANK 32
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static inline unsigned pin_to_bank(unsigned pin)
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{
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return pin / MAX_NB_GPIO_PER_BANK;
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}
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static inline unsigned pin_to_bank_offset(unsigned pin)
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{
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return pin % MAX_NB_GPIO_PER_BANK;
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}
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static inline unsigned pin_to_mask(unsigned pin)
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{
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return 1 << pin_to_bank_offset(pin);
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}
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static __gpio_init void at91_mux_disable_interrupt(void __iomem *pio, unsigned mask)
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{
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__raw_writel(mask, pio + PIO_IDR);
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}
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static __gpio_init void at91_mux_set_pullup(void __iomem *pio, unsigned mask, bool on)
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{
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__raw_writel(mask, pio + (on ? PIO_PUER : PIO_PUDR));
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}
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static __gpio_init void at91_mux_set_multidrive(void __iomem *pio, unsigned mask, bool on)
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{
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__raw_writel(mask, pio + (on ? PIO_MDER : PIO_MDDR));
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}
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static __gpio_init void at91_mux_set_A_periph(void __iomem *pio, unsigned mask)
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{
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__raw_writel(mask, pio + PIO_ASR);
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}
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static __gpio_init void at91_mux_set_B_periph(void __iomem *pio, unsigned mask)
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{
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__raw_writel(mask, pio + PIO_BSR);
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}
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static __gpio_init void at91_mux_pio3_set_A_periph(void __iomem *pio, unsigned mask)
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{
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__raw_writel(__raw_readl(pio + PIO_ABCDSR1) & ~mask,
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pio + PIO_ABCDSR1);
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__raw_writel(__raw_readl(pio + PIO_ABCDSR2) & ~mask,
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pio + PIO_ABCDSR2);
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}
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static __gpio_init void at91_mux_pio3_set_B_periph(void __iomem *pio, unsigned mask)
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{
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__raw_writel(__raw_readl(pio + PIO_ABCDSR1) | mask,
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pio + PIO_ABCDSR1);
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__raw_writel(__raw_readl(pio + PIO_ABCDSR2) & ~mask,
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|
pio + PIO_ABCDSR2);
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}
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static __gpio_init void at91_mux_pio3_set_C_periph(void __iomem *pio, unsigned mask)
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{
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__raw_writel(__raw_readl(pio + PIO_ABCDSR1) & ~mask, pio + PIO_ABCDSR1);
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__raw_writel(__raw_readl(pio + PIO_ABCDSR2) | mask, pio + PIO_ABCDSR2);
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|
}
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static __gpio_init void at91_mux_pio3_set_D_periph(void __iomem *pio, unsigned mask)
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{
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__raw_writel(__raw_readl(pio + PIO_ABCDSR1) | mask, pio + PIO_ABCDSR1);
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__raw_writel(__raw_readl(pio + PIO_ABCDSR2) | mask, pio + PIO_ABCDSR2);
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|
}
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static __gpio_init void at91_mux_set_deglitch(void __iomem *pio, unsigned mask, bool is_on)
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{
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__raw_writel(mask, pio + (is_on ? PIO_IFER : PIO_IFDR));
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}
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static __gpio_init void at91_mux_pio3_set_deglitch(void __iomem *pio, unsigned mask, bool is_on)
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{
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if (is_on)
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__raw_writel(mask, pio + PIO_IFSCDR);
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at91_mux_set_deglitch(pio, mask, is_on);
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|
}
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static __gpio_init void at91_mux_pio3_set_debounce(void __iomem *pio, unsigned mask,
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bool is_on, u32 div)
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{
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if (is_on) {
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__raw_writel(mask, pio + PIO_IFSCER);
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__raw_writel(div & PIO_SCDR_DIV, pio + PIO_SCDR);
|
|
__raw_writel(mask, pio + PIO_IFER);
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} else {
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|
__raw_writel(mask, pio + PIO_IFDR);
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|
}
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|
}
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static __gpio_init void at91_mux_pio3_set_pulldown(void __iomem *pio, unsigned mask, bool is_on)
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|
{
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__raw_writel(mask, pio + (is_on ? PIO_PPDER : PIO_PPDDR));
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|
}
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static __gpio_init void at91_mux_pio3_disable_schmitt_trig(void __iomem *pio, unsigned mask)
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{
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__raw_writel(__raw_readl(pio + PIO_SCHMITT) | mask, pio + PIO_SCHMITT);
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|
}
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static __gpio_init void at91_mux_gpio_disable(void __iomem *pio, unsigned mask)
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{
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__raw_writel(mask, pio + PIO_PDR);
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|
}
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static __gpio_init void at91_mux_gpio_enable(void __iomem *pio, unsigned mask)
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{
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__raw_writel(mask, pio + PIO_PER);
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|
}
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static __gpio_init void at91_mux_gpio_input(void __iomem *pio, unsigned mask, bool input)
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{
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__raw_writel(mask, pio + (input ? PIO_ODR : PIO_OER));
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|
}
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static __gpio_init void at91_mux_gpio_set(void __iomem *pio, unsigned mask,
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int value)
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{
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__raw_writel(mask, pio + (value ? PIO_SODR : PIO_CODR));
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|
}
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static __gpio_init int at91_mux_gpio_get(void __iomem *pio, unsigned mask)
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{
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u32 pdsr;
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pdsr = __raw_readl(pio + PIO_PDSR);
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return (pdsr & mask) != 0;
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}
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#endif /* __AT91_GPIO_H__ */
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